Estoy interconectando un sistema, este sistema emite una señal de pulso digital de 200 ns con un tiempo de repetición de cada 3 ms. El voltaje ideal de la señal sería de 0 V a 3,3 V, pero la señal proveniente del sistema tiene un alto valor de sobreimpulso y subimpulso (valor de hasta +5 a -2 V). y quiero interconectar esta señal con Xilinx 7 series FPGA (artix) con voltaje de banco de 3.3V. Adjuntar es la forma de la señal que obtengo del sistema.
Necesito un circuito que maneje pulsos de 200 ns fácilmente.
Probablemente pueda limpiar esto usando una resistencia en serie al final de la FPGA. Esto ralentizará ligeramente los tiempos de subida y bajada, pero debería eliminar el sobreimpulso y el zumbido. Probablemente tendrá que determinar el valor experimentalmente, 50-100 ohmios es un buen punto de partida.
Esto parece un desajuste de impedancia típico entre el lado del conductor y la línea de transmisión. A partir del tiempo de reflexión/timbre, la longitud del cable parece ser de unas 60 pulgadas. A una velocidad de borde de 10 ns, los efectos de la línea de transmisión están en su lugar.
Para resolver el problema y reducir/eliminar el timbre, necesita dos cosas:
(a) utilice un cable con baja impedancia característica. Utilice un cable coaxial delgado o un cable plano con hilos adyacentes conectados a tierra;
(b) hacer coincidir la impedancia de la fuente con la impedancia característica de la línea. Se puede hacer colocando una resistencia en serie con la línea en el extremo del controlador . Si el cable termina en 80-100 ohmios (cable plano) y la salida típica del controlador es de aproximadamente 25-30 ohmios, necesitará una resistencia de 50-60 ohmios para eliminar el timbre. Repito: AL LADO DEL CONDUCTOR.
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Andy alias
farhan babar
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usuario76844