¿Encontrar el valor de una capacitancia en una celda RAM dinámica? (Electrónica digital)

Tuve este problema en mi final de electronica digital. Quiero saber cómo resolver esto, aunque voy a usar diferentes valores ya que no recuerdo los valores exactos de la prueba. También voy a escribir mi solución, pero solo hice esta solución. porque había visto problemas similares, no entiendo el razonamiento ni siquiera sé si es correcto. Mi objetivo es entender esto, ya que siento que entendí bastante bien todas las demás partes del curso. Pero la electrónica ha sido un gran desafío para mí, ya que soy ingeniero informático.

Información del problema:

El siguiente esquema muestra el circuito de una celda RAM dinámica.

Dibuje aquí.

El transistor es un NMOS. V D D = V W L = 3 V , V T = 1 V Cuando hay una operación de lectura, BL se precarga para V D D 2 . La capacitancia de la línea de bits C B L = 0.1 pag F . Determine el valor mínimo para la capacitancia de la celda C C de modo que durante una operación de lectura, el cambio de voltaje en el BL sea de al menos 10 mV. Ignorar el efecto del cuerpo.

Mi solución:

Para logic-1 el voltaje en C C , V C C ( 1 ) sería V W L V T = 3 1 = 2 V .

Para lógica-0 el voltaje en C C , V C C ( 0 ) bajaría a 0V.

Lógica-1:

El profesor ha usado esta fórmula varias veces, realmente no sé el razonamiento detrás de ella. Cuando pregunté, dijeron conversación de energía. Supongo que simplemente acepté eso, porque parece que tendría sentido. Aquí lo tienes:

C C V C C ( 1 ) + C B L V C B L ( 1 ) = V F ( C C + C B L ) .

Entonces conocemos todos estos valores, podemos conectarlos:

C C 2 V + 0.1 pag F 1.5 V = 1.51 V ( C C + 0.1 pag F )

Y resolvemos para C C , entonces C C = 2.04 F F

Lógica-0:

Usando la misma fórmula que antes:

C C V C C ( 0 ) + C B L V C B L ( 0 ) = V F ( C C + C B L ) .

Conectamos nuestros valores conocidos:

C C 0 V + 0.1 pag F 1.5 V = 1.49 V ( C C + 0.1 pag F )

Encontramos eso C C = 0,67 F F .

Conclusión:

Cuando tenemos logic-1 necesitamos una capacitancia de celda C C = 2.04 F F , y cuando tenemos un 0 lógico necesitamos una capacitancia de celda C C = 0,67 F F , para tener una Δ V B L = 10 metro V . Si hiciéramos la lógica-0 C C más grande, sólo causaría el Δ V B L ser más alto, lo cual estaría bien. Si hiciéramos la lógica-1 C C más pequeño, entonces el Δ V B L sería menos de 10mV.

Por lo tanto, la respuesta es C C = 2.04 F F .

¿Es esto correcto?

Respuestas (1)

Si es correcto. No revisé los números, pero el procedimiento es correcto.

Para ayudarlo a comprender lo que está haciendo, aquí hay una explicación de la fórmula. Cuando realiza una operación de lectura, enciende el NMOS. Esto significa que de alguna manera cortocircuitas Cc y la línea de bits. Se trata de dos condensadores cargados a diferentes voltajes, por lo que al conectarlos se produce una redistribución de cargas. La fórmula que está utilizando en realidad se trata de la conservación de la carga y no de la conservación de la energía. La carga Q almacenada en un capacitor es igual a su capacidad multiplicada por el voltaje en sus conductores:

q   =   C V
Entonces, lo que está haciendo es igualar la carga presente antes de la conexión y la carga presente después, teniendo en cuenta que después del cortocircuito podemos modelar el capacitor Cc-BL como el paralelo de los dos.
q i = q F C C V C C + C B L V C B L = C t o t V F
El voltaje final debe ser mayor que V C B L + Δ V si tuviéramos un nivel alto y menos de V C B L Δ V si tuviéramos un nivel bajo. El uso de esta condición conducirá a dos ecuaciones separadas que se resuelven fácilmente:
C C ( 1 ) C B L Δ V V C C ( 1 ) V B L Δ V C C ( 0 ) C B L Δ V V C C ( 0 ) V B L + Δ V

El valor más alto de capacitancia es el que está buscando.