¿Puede Tiva C ejecutar código desde SRAM?

Todo lo que sé es que aunque los micros Cortex-M3/4 son arquitectura Harvard, pueden ejecutar código desde RAM, al menos algunas implementaciones pueden (como STM32F4). ¿Los microcontroladores de la serie Tiva C pueden ejecutarse desde la RAM?

¿Has leído la hoja de datos?

Respuestas (2)

Hoja de datos del microcontrolador Tiva™ TM4C123BE6PZ

No es inmediatamente obvio en la hoja de datos, pero mire en la página 87-88:ingrese la descripción de la imagen aquí

Tiene dos buses pero solo un espacio de direcciones ; por lo que puede ejecutar programas de varias regiones, pero se le recomienda que solo obtenga el beneficio de poder realizar una obtención de instrucciones y una obtención de datos al mismo tiempo si son de diferentes regiones.

Por supuesto, esto significa que la ejecución de código desde SRAM será más lenta. Flash, por lo que entendí, tiene estados de espera cuando opera a más de 40 MHz que se mitigan mediante el uso de un búfer de captación previa.
Asumiría que la SRAM interna era de un solo ciclo a menos que diga lo contrario.

memoria en chip

SRAM de ciclo único de 32 KB ubicada en 0x2000.0000 (para almacenamiento de código)

■ 256 KB de memoria Flash en chip de ciclo único (página 528)

■ EEPROM de 2KB (para almacenamiento de datos no volátil)

El programa se almacena en flash y las variables en SRAM

@ pjc50 es perfecto con la imagen y la descripción.

El Cortex-M4F obtiene previamente las instrucciones antes de la ejecución y las obtiene especulativamente de las direcciones de destino de las sucursales

[1] Página 96 de la ficha técnica de TIVA C

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